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プロジェクト概要

Signsは様々なハードウェア記述言語でのハードウェア設計のための開発環境です。タックルタスクがあり、コンパイル、合成、シミュレーション、およびデザインのテスト。これらの主な領域の統合のために、ネット、ソースコード、シミュレーション間の切換えによる包括的な設計のデバッグ機能を提供します。サポートされる言語には、VHDLおよびISCASベンチマーク形式が含まれます。Signsには２種類あります：大規模なネットリストを処理・解析するのに有用なコマンドラインのみのバージョンと、ハードウェアの設計とシミュレーションのためのEclipseプラグイン。

システム要件

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プロジェクトのリリース情報やプロジェクトリソースの情報です。
注: プロジェクトリソースの情報は Freecode.com ページからの引用です。ダウンロードそのものは、OSDNにホスティングされているものではありません。

2006-05-06 01:44 リリース一覧に戻る
0.6.1

NAND型/ ISCASネットリストNOR型ツリーの生成、（）を選択し、信号の割り当て精緻化をサポートし、限られたCLAは（加算）の生成は、ネットリストのビューアが追加のツールバーのボタンからダンプしてネットリストの処理機能にアクセスするに固定されているが追加されている固定されているEclipseプラグインは、マウスの信号を選択し、固定されているAntビルドスクリプトはもはや存在しないソース配布物からです。
タグ: Major bugfixes
NAND/NOR tree generation for ISCAS netlists has been fixed, (limited) support for selected signal assignment elaboration has been added, CLA (adder) generation has been fixed, the netlist viewer has additional toolbar buttons to access dump and netlist processing functions from the Eclipse plugin, mouse signal selection has been fixed, and the Ant build script is no longer missing from the source distribution.

プロジェクトリソース

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